半導体アナログレイアウト設計エンジニア
- CAD/EDAエンジニアその他ミックスドシグナルIC設計
- 東京都 神奈川県
- 年収300万~500万円年収500万~700万円年収700万~1000万円
- 提供元:EN転職
- 掲載日:2026年03月17日
求人AIによる要約
次世代半導体デバイスのアナログレイアウト設計エンジニアとして、最先端技術に触れながら、あなたの専門スキルを存分に発揮できる環境が待っています。回路図をもとにTEGチップのアナログ回路を設計し、Calibreなどの最新ツールを用いて精密な物理検証を行います。業務内容にはGDSデータの作成や設計仕様書の作成も含まれますので、幅広いスキルアップが可能です。この重要な役割を通じて、未来の半導体産業をリードする一員となってみませんか?
【おすすめポイント】
・最先端の半導体デバイス設計に関わることができる
・包括的な検証プロセスでスキルを磨く機会
・設計ドキュメント作成を通じて業務の全体像を理解できる
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OUTLINE
CAD/EDAエンジニア
その他
ミックスドシグナルIC設計
■ 業務内容
次世代を担う半導体デバイスのアナログレイアウト設計および検証業務をお任せします。
・レイアウト設計
回路図を基にしたTEGチップ等の
アナログ回路レイアウト構築
・検証業務
各種検証ツール(Calibre等)を
使用した物理検証、および目視
による緻密なエラーチェック
・データ作成
最終的な製造データであるGDS
データの作成・納品
・ドキュメント作成
付随する設計仕様書や報告書の
作成(Officeソフト使用)
【必須スキル】
・設計ツール
CADENCE Virtuoso Layout
Editor XL の実務経験
・検証ツール
Calibre (DRC/LVS/ERC) および
CADENCE RVE を用いた検証スキル
・OS環境
Unix/Linuxコマンドの基本操作
ができる方
・OAスキル
Excel, PowerPoint, Word,
Outlookでの事務処理・報告書
作成
・専門知識
半導体デバイスの構造や動作
や機能に関する基本的な理解
【歓迎スキル】
・LSIレイアウト設計、
またはLSIチップの
評価実務経験
・機能安全(ISO 26262等)に
準拠した設計・評価経験
・Microsoft Visio を用いた図面や
構成図作成スキル
・設計ツール
CADENCE Virtuoso Layout
Editor XL の実務経験
・検証ツール
Calibre (DRC/LVS/ERC) および
CADENCE RVE を用いた検証スキル
・OS環境
Unix/Linuxコマンドの基本操作
ができる方
・OAスキル
Excel, PowerPoint, Word,
Outlookでの事務処理・報告書
作成
・専門知識
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や機能に関する基本的な理解
【歓迎スキル】
・LSIレイアウト設計、
またはLSIチップの
評価実務経験
・機能安全(ISO 26262等)に
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神奈川県横浜市戸塚区吉田町(最寄駅:戸塚駅)
◇ 駅から徒歩5分以内
交通
戸塚駅から徒歩8分
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月給 45万円~55万円※想定年収 540万円~660万円 上記額にはみなし残業代を含みます。※超過分は全額支給いたします。みなし残業代 75,532円 ~ 92,313円/月みなし残業時間 25時間/月【試用期間】試用期間なし
9:00 ~ 17:30 実働時間:7時間45分/日実働7.75時間+休憩45分月残業約25時間程度
完全週休2日制◇ 年間休日120日以上◇ 夏季休暇◇ 年末年始休暇◇ ゴールデンウイーク休暇
・社会保険完備・交通費支給あり・ミニボーナス支給あり(年2回)・昇給あり(年1回)・キャリアアップ教育の一環としてeラーニング受講可能
COMPANY
会社名:テクノヒューマンパワー株式会社
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