ASIC開発
- ASIC/SoC設計FPGA設計デジタルIC設計
- 奈良県
- その他
- 提供元：シャープ株式会社
- 掲載日：2025年02月27日
求人AIによる要約
半導体業界でのチャンス！デジタル複合機に搭載するASICの開発に携わるお仕事です。具体的には、画像処理ASICの開発を通じて、RTL設計からサインオフ、エンジニアサンプルの作成・評価までを行います。さらに、CPLDやFPGAを活用し、複合機ごとに異なる要件に対応できる多様な設計も手がけます。最先端の技術に触れながら、ダイナミックなチームでスキルを磨く絶好の機会です。
【おすすめポイント】
・最先端の画像処理技術に関与できる
・多様なCPLD/FPGA設計で幅広いスキルが身につく
・プロフェッショナルな環境でキャリアアップ可能
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OUTLINE
ASIC/SoC設計
FPGA設計
デジタルIC設計
ディジタル複合機に搭載するASICなどの開発
①画像処理ASICの開発：大規模なLSI開発。RTL設計～サインオフ～エンジニアサンプル作成と評価
②CPLD/FPGAの開発：複合機毎に要件が様々あるため、CPLD/FPGAを多く利用する。多種多様。
電気回路設計経験者で
・論理回路設計スキル
・RTL言語スキル（Verilog)
・シミュレーション・テストベンチ設計スキル（Verilog）
・DDR3/４、PCI Expressなどの高速インターフェースの理解力
・I2C、SPI、UARTなど汎用インターフェイスの理解力
・論理回路設計スキル
・RTL言語スキル（Verilog)
・シミュレーション・テストベンチ設計スキル（Verilog）
・DDR3/４、PCI Expressなどの高速インターフェースの理解力
・I2C、SPI、UARTなど汎用インターフェイスの理解力
奈良県大和郡山市美濃庄町492番地 地図で確認 奈良事業所
JR奈良線・近鉄奈良線「奈良駅」
JR奈良線・近鉄奈良線「奈良駅」
応相談 キャリアに応じて個別に設定
<参考>2024年度大卒初任給：251,000円
時間外手当・通勤手当は別途支給
賃金改定：年1回
賞与：年2回
<参考>2024年度大卒初任給：251,000円
時間外手当・通勤手当は別途支給
賃金改定：年1回
賞与：年2回
8:30～17:15/9:00～17:45（休憩60分を含む）
※勤務地により異なる
※勤務地により異なる
年間所定休日127日（2024年度）
週休二日制
祝日、年末年始、夏季、年次有給休暇、多目的休暇、リフレッシュ休暇等
週休二日制
祝日、年末年始、夏季、年次有給休暇、多目的休暇、リフレッシュ休暇等
COMPANY
会社名：シャープ株式会社
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